基于FPGA动态可重构计算机的三模冗余改进法

基于FPGA动态可重构计算机的三模冗余改进法

论文摘要

为了提高动态可重构计算机自身的抗干扰能力,提出一种基于FPGA的动态可重构计算机的三模冗余改进法.采用三模块比较的容错模式,通过对三模冗余的多数表决电路进行检测和动态重构提升整个系统的容错能力,从而降低系统因表决电路故障而产生的错误.经Virtex-4 FPGA的片上PowerPC处理器对该方法进行系统验证,证明此方法的有效性和正确性.

论文目录

  • 1 传统三模冗余技术
  •   1.1 传统三模冗余技术
  •   1.2 基于FPGA的动态可重构计算机
  •   1.3 故障屏蔽分析
  • 2 冗余表决电路技术
  • 3 实验验证
  • 4 总结
  • 文章来源

    类型: 期刊论文

    作者: 谢燕,张超洋,周启忠,成奎

    关键词: 三模冗余,可编程逻辑门列,故障冗余,重新配置控制器,表决电路

    来源: 宜宾学院学报 2019年12期

    年度: 2019

    分类: 社会科学Ⅱ辑,信息科技

    专业: 无线电电子学,计算机硬件技术

    单位: 宜宾学院中德工程学院,宜宾学院物理与电子工程学院,四川轻化工大学自动化与信息工程学院

    基金: 四川省科技厅重点研发项目(2019YFN0104)

    分类号: TN791;TP338

    DOI: 10.19504/j.cnki.issn1671-5365.20191008.002

    页码: 6-9+71

    总页数: 5

    文件大小: 2016K

    下载量: 103

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