论文摘要
基于TSMC 90 nm CMOS工艺设计一款多模分频器,可以实现的分频比的范围为32～39.详细介绍了多模分频器的各部分模块,包括双模预定标器、S计数器和P计数器,分析并且讨论了P计数器加入与不加入重新定时电路的时序图.本文设计的分频器应用于K波段高速分数分频频率综合器.测试结果表明应用改进后的多模分频器,频率综合器的带内噪声可以优化15 dB,频偏10 kHz和频偏1 kHz的相位噪声可达到81.30 dBc/Hz和72.44 dBc/Hz.
论文目录
文章来源
类型: 期刊论文
作者: 王征晨,武照博,齐全文,王兴华
关键词: 多模分频器,分数分频频率综合器,重新定时电路技术
来源: 北京理工大学学报 2019年11期
年度: 2019
分类: 工程科技Ⅱ辑,信息科技
专业: 无线电电子学
单位: 北京理工大学信息与电子学院北京市硅基高速片上系统工程技术研究中心
基金: 国家自然科学基金资助项目(61301006)
分类号: TN772
DOI: 10.15918/j.tbit1001-0645.2017.329
页码: 1187-1191
总页数: 5
文件大小: 923K
下载量: 65
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